Diseño, síntesis, fabricación y prueba de unHasher SHA-256 en tecnología CMOS de 180 nm
Este reporte surge de un proyecto de cooperación con ingenieros y científicos del departa- mento de Computer Engineering de la Universidad de Utah, Estados Unidos y el Laboratorio de Microelectrónica de la Facultad Regional Buenos Aires de la Universidad Tecnológica Na- cional (FRBA-UTN). En el...
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Publicado: |
2021
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Acceso en línea: | http://hdl.handle.net/20.500.12272/5503 |
Aporte de: |
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circuitos integrados digitales sincrónico asincrónico verilog cmos ipdk integrated digital circuits synchronous asynchronous verilog cmos ipdk Aguirre, Fernando Alpago, Octavio Atencio, Jerónimo Furfaro, Alejandro Pazos, Sebastián Diseño, síntesis, fabricación y prueba de unHasher SHA-256 en tecnología CMOS de 180 nm |
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Este reporte surge de un proyecto de cooperación con ingenieros y científicos del departa-
mento de Computer Engineering de la Universidad de Utah, Estados Unidos y el Laboratorio
de Microelectrónica de la Facultad Regional Buenos Aires de la Universidad Tecnológica Na-
cional (FRBA-UTN). En el mismo se exponen las técnicas utilizadas para la síntesis de un Cir-
cuito Integrado (CI)2 que representa un módulo hasher del algoritmo Secure Hash Algorithm
(SHA-256) lo cual es una función criptográfica de 256 bits de longitud. Este algoritmo adquirió
popularidad con el auge de los BitCoins como criptomonedas. Las técnicas asincrónicas son
las técnicas metodológicas de diseño más prometedoras. En este trabajo se describe lo rea-
lizado en las áreas de lógica, síntesis, layout, testing y manufactura. Cabe destacar que un
componente esencial de su síntesis física fue el desarrollo de un kit de Diseño Físico Interope-
rable (iPDK) para el cual se utilizaron las herramientas de diseño automático de Synopsys® y
Mentor Graphics®. Por otra parte, la manufactura se realizó a través de MOSIS en un proceso
de fabricación CMOS de 180 nm de 6 niveles de metal, provisto por IBM. |
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