Procesador uUTN8B16COP-SF: capacidades y limitaciones del conjunto de instrucciones

El proyecto consistió en el diseño de la arquitectura interna de un procesador didáctico que cumpliese con los requisitos de un procesador real, sin periféricos, y la evaluación de su conjunto de instrucciones a través de programas de aplicación de uso común. El mismo fue diseñado por alumnos de la...

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Detalles Bibliográficos
Autores principales: Argañaras, Gabriel, Miretti, Marco, Depetris, Lorenzo, Busano, Facundo, Ceré, Esteban, Brezzo, Luciano
Formato: Documento de conferencia publishedVersion
Lenguaje:Español
Publicado: neu nueva editorial universitaria 2019
Materias:
microcontroladores
simulación
modos de direccionamiento
capacidad
Acceso en línea:http://hdl.handle.net/20.500.12272/3753
Aporte de:
RIA - Repositorio Institucional Abierto (UTN) de Universidad Tecnológica Nacional
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description El proyecto consistió en el diseño de la arquitectura interna de un procesador didáctico que cumpliese con los requisitos de un procesador real, sin periféricos, y la evaluación de su conjunto de instrucciones a través de programas de aplicación de uso común. El mismo fue diseñado por alumnos de la asignatura Técnicas Digitales I año 2015, de la carrera de Ingeniería Electrónica de la Universidad Tecnológica Nacional Facultado Regional San Francisco. Fue denominado uUTN8B16COP-SF. Consta de un repertorio de 16 instrucciones y es una evolución de su antecesor, el uUTN8B4COP, que poseía 4 instrucciones. El grupo de instrucciones se seleccionó de una lista de comandos que permitieran la mayor variedad de acciones. Su desempeño se simuló en el entorno de desarrollo ISIS PROTEUS versión 8.1 a través de la ejecución de diversos programas.
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