Optimización de herramientas de monitoreo de errores de concurrencia a través de contadores de hardware

Ejecutar eficientemente aplicaciones sobre arquitecturas paralelas requiere desarrollar programas concurrentes. Los errores que pueden aparecer en estos programas son de los más difíciles de detectar, debido a la aleatoridad en el orden de ejecución de los procesos. La mayoría de los trabajos sobre...

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Detalles Bibliográficos
Autores principales: Frati, Fernando Emmanuel, Olcoz Herrero, Katzalin, Piñuel Moreno, Luis, Montezanti, Diego Miguel, Naiouf, Marcelo, De Giusti, Armando Eduardo
Formato: Objeto de conferencia
Lenguaje:Español
Publicado: 2011
Materias:
Ciencias Informáticas
Parallel Architectures
arquitecturas paralelas; programa concurrente; error de concurrencia; detección de errores; depuración; contadores de hardware
Concurrent Programming
Acceso en línea:http://sedici.unlp.edu.ar/handle/10915/18688
Aporte de:
SEDICI (UNLP) de Universidad Nacional de La Plata
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description Ejecutar eficientemente aplicaciones sobre arquitecturas paralelas requiere desarrollar programas concurrentes. Los errores que pueden aparecer en estos programas son de los más difíciles de detectar, debido a la aleatoridad en el orden de ejecución de los procesos. La mayoría de los trabajos sobre detección de estos errores se basan en la instrumentación del programa, lo que introduce un elevado overhead. Para mejorar la eficiencia del proceso de monitorización, algunos autores proponen extensiones de hardware que realizan la tarea, con lo que consiguen reducir sustancialmente el overhead. Sin embargo, resulta inviable su aplicación en entornos de producción debido a que no se cuenta en la actualidad con esa tecnología. Este trabajo propone una alternativa de optimización a este enfoque a través del uso de los contadores de hardware que sí están disponibles en los procesadores actuales. Se presenta un análisis de la propuesta utilizando un algoritmo de multiplicación de matrices paralelo.
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