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| LEADER |
00746cam a2200229 b 4500 |
| 001 |
bimo0001234041 |
| 003 |
armpuni |
| 005 |
20170602142243.0 |
| 008 |
990607s2000 sp | ||| ||spa |
| 020 |
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|a 9701504437
|
| 080 |
|
0 |
|a 681.388
|
| 100 |
1 |
|
|a Pardo Carpio, Fernando
|
| 245 |
1 |
0 |
|a VHDL
|h [Texto impreso] :
|b lenguaje para síntesis y modelado de circuitos
|c Fernando Pardo Carpio, José A. Boluda Grau
|
| 260 |
|
|
|a México
|b AlfaOmega
|c 2000
|
| 300 |
|
|
|a XI, 238 p.
|c 24 cm
|e 1 disco (CD-ROM)
|
| 650 |
|
7 |
|a VHDL (Lenguaje de descripción del soporte físico)
|2 embne
|
| 650 |
|
7 |
|a Circuitos integrados digitales
|x Diseño
|2 embne
|
| 651 |
|
|
|2 LEMB
|
| 700 |
1 |
|
|a Boluda Grau, José A.
|
| 945 |
|
|
|a jmr
|d 2017-06-02
|
| 999 |
|
|
|c 7481
|d 8656
|
| 942 |
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|6 _
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