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| LEADER |
01375nam a2200301a 44500 |
| 001 |
UBP07392 |
| 003 |
AR-CdUBP |
| 005 |
20220310154108.0 |
| 008 |
151212s2000#######|||||||||||||||||spa|d |
| 020 |
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|a 970-15-0443-7
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| 040 |
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|a AR-CdUBP
|b spa
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| 041 |
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|a spa
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| 100 |
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|a Pardo Carpio, Fernando
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| 245 |
1 |
0 |
|a VHDL :
|b lenguaje para síntesis y modelado de circuitos /
|c Fernando Pardo Carpio, José A. Boluda Grau.
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| 260 |
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|a México :
|b Alfaomega,
|c 2000
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| 300 |
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|a xi, 238 p. ;
|c 21 cm. +
|e 1 cd-rom.
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| 504 |
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|a Bibliografía: p. 231-232.
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| 505 |
0 |
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|a Capítulo 1. Metodología de diseño. Capítulo 2. Descripción del diseño. Capítulo 3. Introducción al lenguaje VHDL. Capítulo 4. Elementos sintácticos del VHDL. Capítulo 5. Descripción flujo de datos. Capítulo 6. Descripción conportamental algorítmica. Capítulo 7. Descripción estructural. Capítulo 8. Poniendo orden: subprogramas, paquetes y bibliotecas. Capítulo 9. Conceptos avanzados en VHDL. Capítulo 10. VHDL para simulación. Capítulo 11. VHDL para síntesis. Capítulo 12. Utilización del lenguaje VHDL.
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| 650 |
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4 |
|a VHDL
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| 650 |
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4 |
|a MODELADO DE CIRCUITOS
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| 653 |
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|a TELECOMUNICACIONES
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| 700 |
1 |
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|a Boluda Grau, José A.
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| 930 |
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|a TELECOMUNICACIONES
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| 931 |
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|a 07392
|b UBP
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| 942 |
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|2 cdu
|c BK
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| 945 |
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|a SMM
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| 984 |
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|a 621.38
|b P883
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| 999 |
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|c 22895
|d 22895
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