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| LEADER |
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| 001 |
363 |
| 003 |
AR-RfUN |
| 005 |
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| 008 |
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| 040 |
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|a AR-RfUN
|b spa
|c AR-RfUN
|e rda
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| 020 |
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|a 8489660824
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| 041 |
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|a spa
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| 100 |
1 |
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|a Stallings, William
|e autor
|9 437
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| 245 |
1 |
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|a Organización y arquitectura de computadores /
|c William Stallings.
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| 250 |
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|a 7a ed.
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| 260 |
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|a Madrid :
|b Pearson Educación,
|c 2006.
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| 300 |
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|a 840 p. :
|b tbls., cuadrs.
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| 336 |
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|a text
|b txt
|2 rdacontent
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| 337 |
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|a unmediated
|b n
|2 rdamedia
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| 338 |
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|a volume
|b nc
|2 rdacarrier
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| 504 |
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|a INCLUYE4
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| 505 |
0 |
|
|a Evolución y prestaciones de los computadores
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| 505 |
0 |
|
|a El computador: Perspectiva de alto nivel del funcionamiento y de las interconexiones del computador
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| 505 |
0 |
|
|a Memoria caché
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| 505 |
0 |
|
|a Memoria interna
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| 505 |
0 |
|
|a Memoria externa
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| 505 |
0 |
|
|a Entrada/salida
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| 505 |
0 |
|
|a Sistemas operativos
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| 505 |
0 |
|
|a La unidad central de procesamiento: Aritmética del computador
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| 505 |
0 |
|
|a Repertorios de instrucciones: características y funciones
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| 505 |
0 |
|
|a Repertorio de instrucciones: modos de direccionamiento y formatos
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| 505 |
0 |
|
|a Estructura y funcionamiento del procesador
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| 505 |
0 |
|
|a Computadores de repertorio reducido de instrucciones
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| 505 |
0 |
|
|a Paralelismo en las instrucciones y procesadores superescalares
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| 505 |
0 |
|
|a La arquitectura IA-64
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| 505 |
0 |
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|a La unidad de control: Funcionamiento de la unidad de control
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| 505 |
0 |
|
|a Control microprogramado
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| 505 |
0 |
|
|a Organización paralela: Procesamiento paralelo
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| 505 |
0 |
|
|a Apéndice A: Sistemas de numeración
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| 505 |
0 |
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|a Apéndice B: Lógica digital
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| 505 |
0 |
|
|a Apéndice C: Proyectos para enseñar arquitectura y organización de computadores.
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| 650 |
1 |
7 |
|2 spines
|a informatica
|9 144
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| 650 |
1 |
4 |
|a computadoras
|9 438
|
| 650 |
1 |
4 |
|a soporte logico de computadoras
|9 314
|
| 692 |
|
|
|a IC
|
| 692 |
|
|
|a VJ
|
| 942 |
|
|
|2 ddc
|
| 962 |
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|a info:eu-repo/semantics/book
|a info:ar-repo/semantics/libro
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| 999 |
|
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