Estimación de Capacidad en FPGAs Comerciales
La estimación de consumo medio en circuitos CMOS es un problema aun no resuelto completamente debido a la dificultad en la estimación de la actividad de conmutación. Cuando se trabaja con FPGAs comerciales, a este problema se añade la falta de información sobre las capacidades físicas de los nodos d...
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| Autores principales: | , |
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| Formato: | Objeto de conferencia |
| Lenguaje: | Español |
| Publicado: |
2002
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| Materias: | |
| Acceso en línea: | http://sedici.unlp.edu.ar/handle/10915/22938 |
| Aporte de: |
| Sumario: | La estimación de consumo medio en circuitos CMOS es un problema aun no resuelto completamente debido a la dificultad en la estimación de la actividad de conmutación. Cuando se trabaja con FPGAs comerciales, a este problema se añade la falta de información sobre las capacidades físicas de los nodos del circuito, que se necesita también para estimar el consumo de potencia. En este trabajo se presenta una técnica general para estimar la capacidad de los nodos en un diseño implementado en una FPGA comercial basada en la relación entre capacidad, retardo medio y fan out del nodo. Los resultados preliminares indican que esta solución para estimar capacidades físicas es aplicable con un error tolerable. |
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